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キャリア採用

スタンダードセルIP
開発エンジニア

業務内容

■業務概要

・デジタル回路設計で基本となるスタンダートセルの開発

 

■業務詳細

・スタンダードセルの設計及び各種EDAライブラリ開発
・スタンダードセルのレイアウト, 設計フロー, サインオフ等の開発/設計

勤務地

横浜本社:神奈川県横浜市神奈川区金港町3-1 コンカード横浜13F
三重工場:三重県桑名市多度町御衣野2000番地

※いずれかの勤務地にて採用

応募資格

職種/業界経験 スタンダードセルの開発
語学力 (必須)ビジネスレベルの英語力
英語ドキュメントの読解、英語資料の作成、英語でのミーティング(英語でのディスカッション)
資格 不問
求める経験・能力・スキル  

【経験・能力・資格(must)】
・トランジスタレベルの回路設計の実務経験(Cadence schematic editor/Synopsys HSpice等)
・トランジスタレベルのマニュアルレイアウトの実務経験(Cadence Virtuoso/Siemens Calibre等)

【経験・能力・資格(want)】
・アナログ回路設計, デジタル回路設計
・スタンダードセルの回路設計, キャラクタライズ, EDAライブラリの生成
・Chip設計全般の知識,経験(Physical verification, DFT, Timing closure, IRDrop / EM analysis / P&R)

《求める人物像》
・計画通りに業務遂行できる人材
・チーム及び関連部門とコミュニケーションができる
・新しい技術取得に前向きな人材

面接回数 原則2回
適性試験 SPI

勤務条件

昇給 年1回(4月)
試用期間 3ヶ月
賞与 年2回
支給月(6月、12月)
手当 通勤手当(全額支給)、ファミリーアシスト手当(家族手当 ※条件有)、住宅手当(※条件有)
京浜地域手当(横浜本社勤務のみ)
休日 年間126日(2024年)
有給休暇 有給休暇:23日間(4月21日~)
※中途入社の場合、初年度は入社日に応じて支給
就業時間

1.横浜本社勤務の場合 8:45~17:30 (休憩時間:60分間)

2.三重工場勤務の場合 8:15~16:45 (休憩時間:45分間)

※フレックスタイム適用 (コアタイム 10:00-15:00)

社会保険 健康保険、厚生年金、雇用保険、労災保険
福利厚生 カフェテリアプラン(選択型福利厚生制度)、企業年金(確定拠出年金制度)、財形貯蓄など
備考 労働組合(ユニオンショップ制)
 
 

 

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